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低电平的理解

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该用户从未签到

发表于 2009-3-25 17:12:08 | 显示全部楼层 |阅读模式

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有个基础问题请问高手:
2 E- g' G% H% J( t        / o& Z- c" }4 S8 e
数字电路定义:: e3 F, M" ~- r8 }: X3 A. g0 D
高电平“1”的电压一般为3-5伏( R5 m4 E% n7 f: z5 _
低电平“0”的电压一般为0-3伏  {1 P/ X) U5 Z$ m
我想请问,按定义来说这里的低电平0-3伏里的0伏也应在低电平的7 n+ }* \# d9 @& l. U% A
        9 {, X8 O. O! O$ K, O1 |
范围内(是有效的),假如一个非门电路它的输入脚输入的是低电
5 d6 _, X$ L/ {9 g       
" A% Q, U9 L2 X5 t' N: {平0-3范围内的0伏,那么这个脚不就是相当于接地了吗?它还能起6 r( `- k4 {; U8 X: H( u
       
, h+ V; G! s9 J7 X到非门的作用吗?9 t5 u1 N6 R; p3 ~1 Y: I
        % z9 x# |. z4 y6 K
我的理解是低电平定义为略高于0伏的,哪怕是0.0001伏。不能就是+ E; z$ g, {# W; i
        , r, e+ E+ U$ e
0伏,那不就是地吗?

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该用户从未签到

发表于 2009-3-25 17:12:10 | 显示全部楼层
所谓高电平、低电平只是指满足逻辑关系的相对电平。在工业现场,噪声、杂波就远远大于电源5伏。也就是说即便没有信号时(应该低电平),可干扰信号已经出现了“高电平”!为了避免这种情况,工业现场的标准电压都选24伏。这样高电平就是20-24伏,低电平0-6伏。可有效地过滤干扰信号。
8 O( }' R8 g& o( [4 P+ h" _" H        " s! B6 w" c+ X  z$ j0 C* O$ j
至于楼主置疑的输入低电平定义为0-3伏并无错处。因为输入方式有多种,可以是前级的逻辑门电路、也可以是继电器的对地触点。对于有些多输入端的门电路,可以将多余的输入端根据需要而接地(0伏)或悬空(内部上拉5伏)。0 _0 Z8 f/ i3 }* k" M8 A

# Y" E1 u6 H/ D2 x$ _. \6 R) ~8 O( a8 [

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该用户从未签到

发表于 2009-3-25 17:12:12 | 显示全部楼层
高、低电平是相对而言,其具体值随电路而,1楼所谓高电平3-5V、低电平0-3V这可能是对TTL电路而言,因TTL集成电路的工作电压为5V,如果对CMOS集成电路其工作电压范围较广可在3-18V,因此高、低电平的具体值是根据工作电压的百分比而定,作为数字电路为了工作可靠总希望电路实际产生的高、低平电压值相差愈大愈好这样就不易产生误动作,所以我喜欢使用CMOS电路因其工作电压范围大输出摆幅大(即高电平接近工作电压值,低电平接近地电位也可称零电位),且价低省电,其缺点是工作速度没有TTL高但作一般工业控制没问题。

该用户从未签到

发表于 2009-3-25 17:12:14 | 显示全部楼层
没事的,0伏也可以,低电平,就是接近零或者等于零伏。
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